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systemverilog-interface（定义、modport、竞争与冒险、clocking、time region）

文章目录

    • 一、使用interface有什么好处？
    • 二、interface的定义和使用方法
      • 2.1 代码示例
        • 2.1.1 常见interface与module连接示例
        • 2.1.2 常见interface与top层连接
      • 2.2 modport
      • 2.3 module和interface区别
      • 2.4 program与module的区别与联系
        • 2.4.1 program里面不能使用always
        • 2.4.2 使用program需要注意的情况
        • 2.4.3 program和module的相似和不同
    • 三、激励时序相关概念
      • 3.1 竞争与冒险
        • 3.1.1 竞争与冒险的相关概念
        • 3.1.2 竞争与冒险的消除

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