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QUARTUS使用之2： signaltap笔记

signaltap 笔记

时间 ：2019年10月23日
地点 ：苏州

前言

之前一直使用chipscope有四年时间，习惯了ISE的CDC使用，我个人的习惯是当FPGA编译时间小于十五分钟时，更愿意使用在线逻辑分析仪，这样的结果更真实，当然Modelsim仿真是很重要的。但是最近工作需要使用ALTERA的FPGA芯片，这就需要我学会使用quartus,我个人认为signaltap在线逻辑分析仪是必须要掌握的软件之一

建立FPGA工程

此部分略过，网上一大堆教程

signaltap

建立signaltap

  1. 打开Signaltap：
    Tools ->SignalTap II Logic Analyzer
  2. JTAG识别：
    右上角 JTAG Chain Configuration :JTAG ready，Hardware为 USB-Blaster[USB-0], Decice为@1：EP3C(10|5)/EP4C(10|6)
  3. Signal Configuration选择采样时钟：
    点击后面的…弹出Node Finder中进行详细筛选条件
    a. Filer选择信号阶段，这里选择Post-Compilation,在综合后的信号中筛选
    b. Named输出要查找的时钟信号或者点击List按钮在Nodes Found列表中查找信号
    c.此次主要是采样从端口进入FPGA的视频信号，所以采样时钟选择外部LCD同步时钟LCD_PCLK,选中后右移到SelectedNo

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