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verilog编码风格 --- 命名规则

  1. 一个module一个文件。

2. 文件名根据内容来命名，如果是task，那么名字的后缀应该加上_task来表示文件内是一些task。

3. 文件名要有意义，描述文件内容。

4. 第一个字符必须是字母，允许使用数字和字母以及下划线

5. 如果名字中有几个单词那么要用下划线隔开

6. 文档和代码中的名字要一致

7. 宏定义和参数全部用大写，其他最好都用小写

8. 宏定义要在顶层模块，因为它是全局的

9. 单个例化时，使用同模块相同的名字，如果有多个例化，加后缀

10.信号名的后缀有很多来表示信号的属性，如
  _z 高阻信号
  _b 低有效信号

11. 在自模块命名上，需要跟上所有上层模块名字作为前缀

12. 整个设计中使用一致的信号名

13. 信号名长度不超过32个字符

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