verilog随记

【芯片设计- RTL 数字逻辑设计入门 11.1 -- 状态机实现 移位运算与乘法 1】

文章目录移位运算与乘法状态机简介SystemVerilog中的测试平台VCS波形仿真阻塞赋值和非阻塞赋值有限状态机（FSM）与无限状态机的区别本篇文章接着上篇文章【芯片设计-RTL数字逻辑设计入门11–
CodingCos·2024-02-08 16:02

时光带不走你

图片来自网络是谁偷了糖果又是谁盗走了梦境我把画笔揣进兜里渴望留住天空的颜色斑斓的色彩搭配惊艳了我的眼眸装饰了我的世界手中的画笔莎莎作响对我而言，如同天籁美好总是稍纵即逝但我曾目睹她的存在就已经十分美好烟雨水楼，江南如梦漆绿的屋檐，引得无数人驻足孤雁也曾仓皇北顾雨下屋檐，古树旁筑那里的故事随岁月而久远那里的人随记忆而历久弥新时光不老
阅读君·2024-02-08 15:43

随记90

昨天，说好的，做的决定：随记写到100，就不再写。我现已有点苦恼：日后在日更，怎么办？说好日更365的。能不能收回决定？没关系，趁这个机会，逼自己一回！
林金秀·2024-02-08 13:06

随记

刘琳坚持第706天分享(2019/5/8）又到了每年最忙最忙的时候，而今年又赶上了孩子中考，所以就更加忙碌了。此刻脑力、体力已经是深度透支，没办法，读书只能暂停了，毕竟在此时此刻我更要先照顾好自己。明天孩子就要一模了，祝福孩子取得优异的成绩！
小溪与大海·2024-02-08 13:32

中考随记

六月初临近中考，儿子要求走读，说实话我有点不太赞同，因为路途太遥远，来回需要将近两个小时，这意味着每天早上6:00要出门，晚上11:30以后才回到家，孩子的作息时间根本没保障。可是叛逆期的孩子根本没有商量的余地，最后我还是妥协了。随后我开始了为期一个月早送晚接的生活，3天过后我开始感恩上天感恩我的孩子，让我每天都能起的那么早能够吸收到大自然的阳气，每天都能在美丽的江边跑上几圈、读上几句经典、还能有
宋少云·2024-02-08 13:53

玄幻随记（3）

花甜明白了虹溯的意思。但她身后就是“虎视眈眈”的花越，一时有些为难。墨迁开辟了一条定向时空通道，便于虹溯传音。全程只有两秒钟。『你先假意拒绝，待到我们出门之时便可动手。』“不知花甜城主意下如何？”虹溯含笑看着对面。“不妥，”花甜微微摇头，“虽然你们表面态度诚恳，但你们毕竟排行最末，我们花城仅强于你们，难免要警惕些。”“既然如此，我们算是白来了一趟。”虹溯叹道，起身出门。墨迁和苏源紧随其后。等到苏源
DIATIME·2024-02-08 08:05

随记

罗马诗人贺拉斯曾说过，“当我们对他人感兴趣时，他人才会对我们感兴趣。”美国成功学导师卡耐基也说过，“与其花两年的时间让他人对你感兴趣，不如花两个月的时间真正对他人感兴趣，这样会给你带来更多的朋友。”
记住我是喵姐·2024-02-08 08:31

使用Verdi或DVE分析波形的一些小技巧

文章目录查看DeltaCycle的方法Verilog和SV的仿真调度机制使用Verdi查看DeltaCycle的方法使用DVE查看DeltaCycle的方法Verdi的一些其他小技巧总线拆分事件统计逻辑运算修改参数显示进制查看
小破同学·2024-02-08 07:12

AD9361纯逻辑控制从0到1连载7-根据射频频率计算VCO参数

AD9361从0到1连载8-fastlock之profile存器设置verilog实现不管是使用使用何总方法，要修改射频频率，首先需要计算出对应的VCO参数。
冰冻土卫二·2024-02-08 07:11

AD9361纯逻辑控制从0到1连载3-初始化模块

初始化代码的工作，就是将上个章节生成verilog函数中的命令条条执行，碰到需要等待的地方等待，需要读某个标志位的地方就一直读，直到标志位符合要求。下面贴出初始化代码。
冰冻土卫二·2024-02-08 07:40

AD9361纯逻辑控制从0到1连载2-将脚本转化为verilog代码

首先查看一下，上一章我们生成的脚本文件fdd_600m：//************************************************************//AD9361R2AutoGeneratedInitializationScript:Thisscriptwas//generatedusingtheAD9361CustomersoftwareVersion2.1.3
冰冻土卫二·2024-02-08 07:39

AD9361纯逻辑控制从0到1连载1-生成初始化脚本

好在ADI官方提供了界面化的软件，可以根据图形化的配置，生成初始化的脚本，我们要做的就是将这个脚本转换为对应的verilog语言。
冰冻土卫二·2024-02-08 07:09

【芯片设计- RTL 数字逻辑设计入门 11 -- 移位运算与乘法】

请阅读【嵌入式开发学习必备专栏】文章目录移位运算与乘法VerilogCodeverilog拼接运算符（{}）TestbenchCodeVCS波形仿真问题小结移位运算与乘法已知d为一个8位数，请在每个时钟周期分别输出该数乘
CodingCos·2024-02-08 07:38

05 06 Verilog基础语法与应用讲解

05.1.位操作计数器实验升级，设计8个LED灯以每个0.5s的速率循环闪烁（跑马灯）1.1方法1：使用移位操作符<<来控制led灯的循环亮灭设计代码Verilog中，判断操作的时候不加位宽限定是可以的
Dale_e·2024-02-08 07:36

FPGA的VGA显示基础实验

文章目录VGA介绍基本定义管脚定义VGA显示原理VGA通信协议VGA时序解析VGA显示字符实验准备建造工程运行结果VGA显示彩色条纹工程结果展示VGA显示彩色图片准备工程ROMIP核PLLIP核调用Verilog
小艺的小依·2024-02-08 06:29

周末随记

又到了周末，心里自然就放松了。周一至周五，每天网课，催作业，改作业……眼睛觉得干涩，经常有疲倦感。昨夜到今天上午，小雨淅淅沥沥地断断续续地下着，有点倒春寒，还好，没有寒风刺骨之感。春风春雨比冬风冬雨温柔多了，风儿柔和地抚摸着脸庞，春雨似有似无地沾湿衣裳。雨天，院中的小花格外娇艳，小草小树像被洗过似的，绿中透亮。吃过早饭，上桥头边买点蒜苔、白菜，卖菜的大娘既和蔼可亲又善良，她竟然把莴笋叶免费送给我一
hxh夏日物语·2024-02-08 06:59

随记│开学26日

开学二十六天，今天还是在淅淅沥沥的下着小雨呀，不过还好下午倒是没有下雨诶，就还挺好捏，不过吧就挺不能理解的，这是回南天气开始了吗？咋就这么潮呢。是真的好潮湿哇！就说说那地，那可真是久久不干啊，然后吧也是巧了，学校里清理空调的师傅来搞空调哇，这地也就更湿啦，索性来打扫一下，呜就挺离谱，这都到了晚上哇还是没干诶。然后有一丢丢头绪啦，明天打算好好的展开思考哇。恩！虽然明天是周末，但还是得早早的起床哇嘿！
Silence的小茶馆·2024-02-08 06:21

随记

今天不在公司，这周也不在公司因为三个会连轴转，分别在不同的地方。所以很完美的解决了我每天需要编写每日报表的痛苦，虽然很累，虽然要加班。比如现在马上十点了，我刚打上回家的车。明天一早还要早起去会议中心。之后呢是去海泉湾。总之这周很忙。昨天姐姐说你写的不和主题，我觉得呢，姐姐对的。可是我还没功夫想想我自己的好，因为我觉得我自己挺好的哈哈，真的，自恋新高度。我很热情的，对工作也几乎不抱怨，同事让我帮忙会
小猪天堂·2024-02-08 05:18

2018-11-29 随记

学习这件事很重要，不是一时半会就能看到结果的，这是需要我们持之以恒的坚持下去才能看到的效果，要对自己有信心，而且要找到学习的乐趣，主动学习，爱上学习，拟定学习目标，具体到时间，章节和学习目标的明确，春夏秋冬在变，但是，我们学习的初衷不会变。
Ai文Wen·2024-02-08 04:35

2.1 Verilog 基础语法

格式Verilog是区分大小写的。格式自由，可以在一行内编写，也可跨多行编写。每个语句必须以分号为结束符。空白符（换行、制表、空格）都没有实际的意义，在编译阶段可忽略。例如下面两中编程方式都是等效的。
二当家的素材网·2024-02-08 03:19

1.2 Verilog 简介及发展历史

Verilog具有很强的电路描述与建模能力，能从多个层次对数字系统进行描述和建模。因此，在简化硬件设计任务、提高设计效率与可靠性、语言易读性、层次化和结构化设计等方面展现了强大的生命力与潜力。
二当家的素材网·2024-02-08 02:10

1.1 Verilog 教程

VerilogHDL（简称Verilog）是一种硬件描述语言，用于数字电路的系统设计。可对算法级、门级、开关级等多种抽象设计层次进行建模。
二当家的素材网·2024-02-08 02:09

Verilog刷题笔记22

题目：Buildapriorityencoderfor8-bitinputs.Givenan8-bitvector,theoutputshouldreportthefirst(leastsignificant)bitinthevectorthatis1.Reportzeroiftheinputvectorhasnobitsthatarehigh.Forexample,theinput8’b1001
十六追梦记·2024-02-08 00:22

Verilog刷题笔记23

题目:Supposeyou’rebuildingacircuittoprocessscancodesfromaPS/2keyboardforagame.Giventhelasttwobytesofscancodesreceived,youneedtoindicatewhetheroneofthearrowkeysonthekeyboardhavebeenpressed.Thisinvolvesaf
十六追梦记·2024-02-08 00:50

随记│放假144日

放假第一百四十四天哇，今天天气也还可以啦，早上起床时间是这几天以来最早的一天啦，咋说呢就是真的冬天遭不住啊，这太冷啦，只想缩在被窝里，暖和啊，可是还有要事去做，所以得要早起嗷！早上一顿忙碌下来，总算是出门啦，戴上最近喜欢的帽子，恩很不错啊哈哈哈，不过去的时候心情不是很美丽啊，怪我昨晚睡太晚，今天稍早点休息呀，得好好调整调整作息的呀。然后去了吧，咋说呢搞了很久，然后略显有点，诶是不知如何说啊，反正就
Silence的小茶馆·2024-02-08 00:06

fpga verilog需要注意的一些代码规范以及易错点

fpga里面乘法符号*一个周期是算不出来的，所以例如data*3可用data+data+data代替，加法可在一个周期内算完，才会保证不出错误
一枚清澈愚蠢的研究生·2024-02-07 22:30

随记

趁着周末把《典籍里的中国》前两集都看完了，先说说第一集《尚书》，汉无伏生，则《尚书》不传，传而无伏生，亦不明其义。《尚书》这个名字最早在看孔子故事的时候有读过，但是记忆已经很模糊了，浅薄的知识量让我对这本书了解真是不多，通过节目才知道，那个时代的读书人心怀家国天下的广阔胸襟。伏胜护书、传书、讲书是为了让后世读《书》而知先贤治政之本，读《书》而知朝代兴废之由，知个人修身之要。书里的观念，民惟邦本，本
俩小子的妈·2024-02-07 19:24

随记

今天是6月8号，高考的日子，说来奇怪，虽然已经上了大学，但是还是忍不住去关注高考这个事件，偶尔看见空间里面的加油打气动态还挺让人感觉到温暖的，也容易勾起回忆。恍恍惚惚在记忆中就会浮现一些高中时候的碎片或者称为片段吧，仿佛时间是开了逆时针一样，从现在大学生活倒退到假期再倒退到高考然后备考的时间、住校的生活、一起和宿舍奋斗的很晚、艺考结束回来、参加集训的岁月……许许多多的画面就浮现了出来，想是决了堤的
蓝栉·2024-02-07 16:14

随记

真正的稳定，不是在一家单位有饭吃，而是无论走到哪儿，都有饭吃。鸟儿站在细细的树枝上，给它安全感的不是脚下的树枝，而是它飞翔的能力。爱过恨过，皆成经过。好事坏事，终成往事。我们来世上走一遭，不该囿于过往，而应为了过好每一天，奋力发光。我于昨晚去世，走时心如止水，我于今早重生，来时心怀暖阳。生命来来往往，来日并不方长。我们总以为，是生活欠我们一个满意。其实，是我们欠生活一个努力。
young不二·2024-02-07 11:50

随记

我住在南方，一年四季，春有百花秋有月，夏有凉风，唯冬少有雪，雪是可遇不可求的冬景。我见过最大最美的一场雪是在2008年，那场雪是诗人笔下雪的场景再现，漫天的鹅毛飞舞，洋洋洒洒，随性而又洒脱，不骄不躁。雪落在掌心上，凉凉的，它起初还是霜雪的白，后来变得透明，然后化为水从指缝中溜走。雪是抓不住的，即使我把装在瓶子里密封放在冰箱里，它还是会走，它成了冰块，成了水，它还是雪，却不是最初的模样。那场大雪成了
却屿·2024-02-07 10:58

【SpinalHDL】3.奇淫技巧

anonymSignalPrefix”字符串中的内容达到你想要的前缀，Scala中代码如下：objectTopextendsApp{SpinalConfig(anonymSignalPrefix="tmp").generateVerilog
sinply6·2024-02-07 10:38

随记│河南加油

今天也是悠闲的一天噢，随便做点啥一天就没了呜呜，好想时间不曾走动啊。说来今天关注了河南暴雨，很担心也很感动，担心受灾群众的安危，也很感动在严峻的灾情下，抗洪官兵的奋力救援还有无数心系灾区的人们。看到那些抗洪视频，我破防了，也泪目了，真的真的很感动，在灾难面前我看到了中国力量，我为我生在华夏是一名中国人而感到自豪和骄傲。想起那年汶川地震救灾，如今的河南暴雨救援，我不禁感叹这是中国人骨子里的温良啊，正
Silence的小茶馆·2024-02-07 09:36

随记

刘琳焦点讲师班坚持第380天原创分享(2018/6/16）今天晚饭后大家一起回看孩子们四岁时的录像。那时候的他们，没有任何的困扰，没有任何的担心，有的只是属于他们的最幸福的笑容。儿子那时候真的特别的调皮，也特别的可爱。一个小小的玩具、一段快乐的歌曲都能让他开心的满屋子乱蹦。而如今已经整整十年过去了，现在的儿子已经变成了一个有担当的男子汉。现在的她要面对很多成长所必须面对的东西，这使他变得更加的稳重
小溪与大海·2024-02-07 09:33

隆昌寺学习随记四

隆昌寺学习随记四第二天的学习就是充满感动的一天。感恩维师的精心设计，看似没有复杂的理论学习，但是这是一个实修的过程。说是一个层面，知是一个层面，修更是一个层面。只有把认知转化为行动，才能做到知行合一。
王子__惟永居士·2024-02-07 09:50

随记今天的事儿

活结昨日达二万步为弟是莫样晃悠？么样晃，你站好莫骇达倒了，尽在协和同济两个医院倒腾，搞么丝？看病！莫样？垓是老病吗？上次见面不是说好了许多怎么又复发了？埃是一直就那样？我还想这几天天气如不错哥卵子再聚一聚呢！是的，又做了几个检查，挂的五四那天的专家号，再拿结果克，看医生么样讲！聚的话再说[捂脸]想必不会有太大问题，望弟早日康复！再聚！[玫瑰][玫瑰][玫瑰]老哥正门占还在金挢书院看书！你已经是老学
会仁·2024-02-07 08:29

HDL Designer 2021.1 如何将默认编辑器修改为VsCode

第1步安装Vscode第2步添加Vscode至HDLDesigner第3步更改HDLDesigner编译器第4步修改结束，在HDLDesigner中双击block可使用Vscode编辑verilog
是ZZJin·2024-02-07 08:14

日记随记2

张小英【每日好习惯五件事】1.早起学习，5:002.对镜子，家人，他人微笑；3.滚背137下（第4天）有些运动强度之后的微微酸痛4.跪坐20分钟5.读《道德经》，第31-40章；《易经》乾坤2卦，《黄帝内经》素问上，第一至第四以上倒记录2020.01.13的昨天在微信群里跟子栋老师，贺晓燕老师发愿，春节都坚持早起，不打烊，为了孩子，力求不留遗憾，这就是女子本弱，为母则刚。是的，应该是的!40年首次
哲瑛·2024-02-07 07:26

1.3 Verilog 环境搭建详解教程

学习Verilog做仿真时，可选择不同仿真环境。
二当家的素材网·2024-02-07 05:43

【INTEL（ALTERA）】错误 （22595）： 英特尔 Quartus不支持“BDF”类型的实体“entity_path/entity_name”

任何现有的BDF设计文件都必须转换为VerilogHDL或VHDL。
神仙约架·2024-02-07 04:55

周末随记

一直想记录下，上个周。周六照旧陪着暖跳舞，然后约会了她的小伙伴小桃子，一起疯了半天，最后桃子不让暖走一直哭，暖姐姐若无其事的在那喊我要回家，我想我爸爸。呃。。。能不能照顾下别人的感受啊，我的姐姐。这会忽然想起来王芳老师讲的角色互换的游戏，下次试试。周天，小南说去纽斯吧。我犹豫半天，说咱俩照顾不了三个吧。她说孩子大了不用照顾，每次去helen自己玩的也很好。于是问暖姐姐能不能自己玩和helen姐姐玩
小猪天堂·2024-02-07 04:20

Verilog刷题笔记18

题目：Anifstatementusuallycreatesa2-to-1multiplexer,selectingoneinputiftheconditionistrue,andtheotherinputiftheconditionisfalse.解题：moduletop_module(inputa,inputb,inputsel_b1,inputsel_b2,outputwireout_ass
十六追梦记·2024-02-07 03:17

Verilog刷题笔记19

题目：Acommonsourceoferrors:HowtoavoidmakinglatchesWhendesigningcircuits,youmustthinkfirstintermsofcircuits:IwantthislogicgateIwantacombinationalbloboflogicthathastheseinputsandproducestheseoutputsIwanta
十六追梦记·2024-02-07 03:17

Verilog刷题笔记21

题目：Apriorityencoderisacombinationalcircuitthat,whengivenaninputbitvector,outputsthepositionofthefirst1bitinthevector.Forexample,a8-bitpriorityencodergiventheinput8’b10010000wouldoutput3’d4,becausebit[
十六追梦记·2024-02-07 03:17

Verilog刷题笔记20

题目：CasestatementsinVerilogarenearlyequivalenttoasequenceofif-elseif-elsethatcomparesoneexpressiontoalistofothers.ItssyntaxandfunctionalitydiffersfromtheswitchstatementinC
十六追梦记·2024-02-07 03:46

学习打卡

【随记】：印光大师说，一分诚敬得一分利益，十分诚敬得十分利益。诚敬是一个人为人处，立身行道的最起码的品德，父母要从小教给孩子，否则
山水伊人1·2024-02-06 23:04

谈谈安全对抗的本质

今年的活动，笔者和去年一样，镇守公司，运筹帷幄之中，决胜千里之外，记得去年笔者写过一篇文章《攻防演练后的一点随记》，里面有段内容，如下：今年笔者团队的工作与去年基本一致，主要处理各个兄弟团队和各渠道提交过来的样本以及一些应急响应分析溯源的工作
熊猫正正·2024-02-06 20:33

随记

1.喜欢的少年是你，反过来还是你。2.白茶清欢无别事，我在等风也等你。3.本就是匆匆过客，又何必耿耿于怀。4.当时的他是最好的他，现在的我是最好的我。5.此情隔山海，山海亦可平。6.多年后若能重逢，道别来无恙。7.原是今生今世已惘然，山河岁月空惆怅，而我，终将是要等着你的。8.我已亭亭，无忧亦无惧。9.既然选择了远方，便只顾风雨兼程。10.我愿化为剑，永生永世顾你周全。11.向来缘浅，奈何情深。既
是林橘呀·2024-02-06 20:57

FPGA快速入门路径

适合新手的FPGA入门路径总体路径规划基础学习-verilog语言verilog语言学习，推荐verilog数字系统设计一书，讲解比较详实和全面。
zuoph·2024-02-06 18:14

2019-07-21中山公园读书会

随记：1.早上被子栋老师的精神及大爱深深感动，我们总是有太多的理由没有坚持早起听课或是其他的事情。比如有时候我就以出差为由的申请不听早课，但其实困难并没有那么多，特别是东南亚的
小小惠_bdaf·2024-02-06 18:51

疫情随记2

因为疫情，我目前还在家中，这也是最近几年在家待的最久的一次吧，可以陪陪父母，和他们待得更久一点。今年年前的时候，我们村后面的山上在做风力发电站，借着这个机会，村里各家出了点钱把各家门前的路硬化了，村里也隔三差五地放了好的垃圾桶，比以前干净多了。
YXM142857·2024-02-06 18:02
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